Автоматизация проектирования изделий электронной техники

Автоматизация проектирования изделий электронной техники, исходя из степени однородности задач и методов их решения в процессе проектирования изделия, подразделяется на

Автоматизация проектирования изделий электронной техники

Курсовой проект

Компьютеры, программирование

Другие курсовые по предмету

Компьютеры, программирование

Сдать работу со 100% гаранией

 

 

 

 

 

 

 

 

 

 

 

 

 

Курсовая работа

 

Автоматизация проектирования изделий электронной техники

Введение

 

Основные задачи развития технологии электрического монтажа - это увеличение плотности компоновки элементов, обеспечение режима согласования линий связи и равномерного распределения потенциалов питания между активными элементами электронных устройств. Оптимальным средством решения этих задач является печатный монтаж благодаря таким его преимуществам перед другими методами монтажа, как компактность конструкций изделий на печатных платах, автоматизации проектирования соединений, что позволяет составлять программы управления технологическим и контрольным оборудованием.

Автоматизация проектирования изделий электронной техники, исходя из степени однородности задач и методов их решения в процессе проектирования изделия, подразделяется на следующие четыре этапа:

  1. системотехническое проектирование, при котором выбираются и формулируются цели проектирования, формируется структура будущего изделия, определяются его основные технико-экономические характеристики;
  2. функциональное (схемотехническое) проектирование, в ходе которого выбирается функционально-логическая база, разрабатываются принципиальные электрические схемы изделий электронной техники в целом и ее составных частей, оптимизируются ее параметры;
  3. техническое (конструкторское) проектирование, которое решает задачи синтеза конструкций изделия в целом, определяет компоновку и размещение, разрабатывает топологию электрических соединений;
  4. проектирование технологических процессов, которое предусматривает определение состава технологического оборудования для изготовления печатной платы, подготовку необходимых организационно-технических мероприятий, связанных с обеспечением функционирования технологических линий изготовления печатных плат, и разработки правил подготовки проекта печатной платы для ее изготовления в единичном, мелкосерийном и крупносерийном вариантах.

1.Разбиение функциональных элементов по корпусам микросхем

 

Общее описание алгоритма.

Общая схема процесса последовательной компановки по связности имеет следующий вид.

Пусть дана схема соединения элементовов множеств

 

.

 

Определим последовательный процесс назначения элементов

 

 

в узлы Br(),на каждом шаге которого выбирается один из неразделенных элементов и приписывается очередному узлу.

Узел считается завершенным, если число элементов в узле равно зачетному числу K.

После завершения очередного узла аналогичная процедура повторяется для следующего узла, причем кандидатами для назначения являются элементы не включенные в предыдущие узлы. Процесс заканчивается когда все элементы из множества E распределены.

Исходные данные являются:

-электрическая схема устройства.

-максимально допустимое число элементов в модуле.

Электрическую схему удобно представлять графом G=(E,V) , где множество вершин Е соответствует элементам эл-ой схемы, а множество ребер V -эл-ким связям между элементами. В таком виде задача компоновки может быть сформулирована как задача разрезания графа G=(E,V) на множество подграфов

 

Gr=(Er,Vr) ,где r=1,2,3….

 

В каждом подграфе число вершин соответственно Er должно не превосходить ранее заданного ограничения на число элементовов в узле К. Для любого разбиения должны выполняться следующие условия:

 

(1)

=Æ; (2)

(3)

 

При проведении компоновки без учета ограничения на кол-во внешних выводов в узле все модули, кроме последнего, будут иметь полное заполнение . и последнее условие примет вид

 

(4)

 

Пошаговое описание алгоритма.

Шаг 1.

Формирование очередного подграфа Gr(r=1,2,3…) начинается с выбора базовой вершины из множества нераспределенных вершин Ir . В начале процесса все вершины считаются нераспределенными, т.е. Ir=E.Критерием выбора вершины на роль базовой является ее степень () (под степенью вершины графа будем понимать кол-во ребер данного графа, инцидентных ей). Выбор происходит в соответствии со следующим условием:

 

(5)

 

Базовая вершина будет первой по порядку вершиной подграфа Gr(Er,Vr), а оставшиеся вершины, принадлежащие множеству , являются кандидатами для включения в подграф Gr на последующих шагах алгоритма.

Базовая вершина является, во-первых, как бы центром группирования, к которому прибавляются новые вершины, во-вторых, центром факторизации.

Шаг 2.

Из множества выделяется подмножество Г() вершин, связанных с .Шаг 3.

Для эл-та X введем функционал:

 

L(x)= (6)

 

определяющий число цепей , связывающих вершину X и вершины из множества Г и Ir\.Для упрощения записей будем отождествлять элемент (множество элементов).для формального вычисления функционала будем пользоваться формулой:

 

(7)

 

где -число связей между вершинами и .

Шаг 4.

Из всех вершин выбирается такая, у которой значение функционала минимально. Очевидно,что вершина для которой это условие будет выполняться , максимально связана с . Эта вершина включается во множество Еr вершин Gr.

Множество вершин подграфа Gr приобретает следующий вид:

 

 

где , а верхний индекс в обозначении в общем случае указывает кол-во шагов выборки.

Шаг 5.

Происходит стягивание вершин подграфа Gr в вершину .Этот процесс далее будем называть факторизацией, вершину - центром факторизации, а кол-во вершин стянутых в ,кроме него самого, степенью факторизации.

Центр факторизации со степенью факторизации ,отличной от нуля, будем обозначать символом и называть гипервершиной степени .

После данного процесса множество преобразуют в одноэлементное множество

 

содержащее гипервершину степени .

 

В указанных обозначениях первый процесс факторизации запишется следующим образом:

 

.

 

В общем случае на ом шаге выборки все указанные преобразования будут иметь вид:

 

.

 

=1,2,3…,Кс-1 ,где Кс-допустимая мощность множества вершин формируемого подграфа (кол-во элементов в конструктивном узле).

Шаг 6.

Действия описанные в шагах 2,3,4,5, повторяются до полного заполнения формируемого модуля.

Далее весь процесс повторяется до тех пор, пока не будет сформирован (-1) модуль. Последний же -й полностью включает в себя множество , так как

.

 

Выполнение компоновки.

В данной электрической функциональной схеме элементы типа И-НЕ заменим элементами 2И-НЕ, в целях уменьшения количества микросхем и себестоимости платы. Данную электрическую функциональную схему разбиваем на 3 блока. Далее выполняем компоновку для каждого блока, для чего представляем их в виде графов, где множеству вершин соответствуют элементы электрической схемы блока, а множество ребер электрическим связям между этими элементами.

Расчеты для первого блока:

Чертим граф для элементов типа 3И-НЕ:

 

Рис.1

 

Составляем матрицу смежности

Т1Т2Т3Т4Т5Т6Т7Т8Т9Т10Т11pТ1002001200106Т2000110012005Т3200001100105Т4010020011005Т5010201012007Т6101010110117Т7201001010106Т8010111101118Т9020120010107Т10101001111017Т11000001010103

За базисную принимаем максимально связанную вершину, т.е. Т8. Она связана с вершинами Т2, Т4, Т5, Т6, Т7, Т9, Т10, Т11.Считаем функционал:

F2=5-1=4; F4=5-1=4; F5=7-1=6; F6=7-1=6;

F7=6-1=5; F9=7-1=6; F10=7-1=6; F11=3-1=2.

Выбираем Т11 т.к. F11 минимально

Т1Т2Т3Т4Т5Т6Т7Т9Т10Т811pТ100200120106Т200011002015Т320000110105Т401002001015Т501020102017Т610101010127Т720100100116Т902012000117Т1010100111027Т811000001001211За базисную принимаем максимально связанную вершину, т.е. Т811. Она связана с вершинами Т2, Т4, Т5, Т6, Т7, Т9, Т10.Считаем функционал:

F2=5-1=4; F4=5-1=4; F5=7-1=6; F6=7-2=5;

F7=6-1=5; F9=7-1=6; F10=7-2=5.

Выбираем Т2 т.к. F2 минимально и с минимальным порядковым номером.

 

Т1Т3Т4Т5Т6Т7Т9Т10Т2811pТ10200120106Т32000110105Т40002001025Т50020102027Т61101010127Т72100100116Т90012000137Т101100111027Т281100001001416

 

В результате проведения процесса последовательной компоновки конструктивных узлов РЭА, получили электрическую принципиальную схему состоящую из четырёх микросхем К155ЛА4 , DD1={2,8,11}, DD2={4,5,9}, DD3={1,3,6}, DD4={7,10};трёх К155ЛА3 DD5={3,7,8,9},DD6={1,2,4,6}, DD7={5,10}, четырёх К155ЛР1 DD8={4,6}, DD9={2,7}, DD10={3,5}, DD11={1}.

Схема электрическая принципиальная приведена в приложении 1. По этой схеме построим граф (рис. 2).

 

Рис.2

 

2. Размещение элементов на плате

 

2.1 Краткое описание алгоритма последовательной установки элементов РЭА

 

Алгоритм последовательной установки РЭА не требует первоначального размещения элементов. Сущность этого этапа состоит в последовательном закреплении элементов РЭА на монтажной плате относительно каких-либо ранее закрепленных элементов. При этом из числа не размещенных элементов выбирается тот элемент, для которого характеристика, связанная с длиной связи относительно ранее размещенных элементов, оказывается наил

Похожие работы

1 2 3 > >>